仿真

与往常一样，您可以使用标准仿真工具来仿真 SpinalHDL 生成的 VHDL/Verilog。然而，从 SpinalHDL 1.0.0 开始，该语言集成了一个 API 来编写测试平台并直接在 Scala 中测试您的硬件。该 API 提供了读取和写入 DUT 信号、分裂和合并仿真的进程、休眠和等待直到达到给定条件的功能。因此，使用 SpinalHDL 的仿真 API，可以轻松地将测试平台与最常见的 Scala 单元测试框架集成起来。

为了能够仿真用户定义的组件，SpinalHDL 使用外部 HDL 仿真器作为后台。目前支持四种仿真器：

• Verilator

• GHDL

• Icarus Verilog

• VCS （实验性，自 SpinalHDL 1.7.0 起）

• XSim （实验性，自 SpinalHDL 1.7.0 起）

使用外部 HDL 仿真器，可以直接测试生成的 HDL 源文件，而不会增加 SpinalHDL 代码库的复杂性。